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多核ECU開發(fā)交流和培訓會 (收費日：3天，15th -17th , April, 上海)

1. TA 專題（第一天）
   1. 時間模型輸入：AutoSAR， AMALTHEA, OT1
   2. 如何建立系統(tǒng)的時間模型：
      1. HW model, OS model, SW model
      2. Stimulation, Mapping, Architecture
   3. 系統(tǒng)要素和時間需求
      1. Event chains需求
      2. Process需求
      3. Runnable 需求
      4. Model的限制
   4. 仿真結(jié)果的顯示和分析
      1. Process table, runnable table, hardware resource table
      2. Histogram view, Gantt chart view,load chart view
      3. Analyze event chains, analyze fulfillment of requirements
      4.  evaluation view
   5. 如何優(yōu)化系統(tǒng)時間特性
      1. 配置模型、資源部分，進行優(yōu)化
      2. 優(yōu)化結(jié)果的顯示和分析
   6. TA inspector
      1. 不同Trace信息的導入
      2. 與其他工具的接口
2. T1 專題 （第二天）
   1. 測試結(jié)果分析和系統(tǒng)優(yōu)化
      1. CPU負荷—任務(wù)/SWF時間
      2. Memory分配—變量數(shù)據(jù)訪問頻率
      3. 多核負載平衡—最大時間
      4. 多核數(shù)據(jù)的分區(qū)訪問—變量數(shù)據(jù)訪問頻率
   2. 如何找出時間異常bug
      1. 數(shù)據(jù)訪問異常值
      2. Trap掉入
      3. 數(shù)據(jù)流/函數(shù)調(diào)用樹
   3. 驗證時間特性要求、限值和調(diào)度模型驗證
   4. 如何集成T1， （T1與目標板接口（PLS）, T1與HighTec編譯器）
3. HighTec 專題（第三天，上午）
   1. Link環(huán)節(jié)
   2. Make file
   3. Code coverage analysis with simulator
   4. Aurix based Applications source code with HighTec ( Hybridkit and EPS kit)
4. PLS專題（第三天，下午）
   1. ED芯片的Trace和集成調(diào)試
   2. GTM調(diào)試
   3. 新功能介紹和演示，stack view, Trace analysis,  A2L
   4. AuroRA Trace實現(xiàn)code coverage analysis功能